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/* SCIF3 Registers for Dummy write */
#define SCIF3_BASE (0xE6C50000U)
}
/* Initialize ch0, Reset Descriptor */
- mmio_write_32(RTDMAC_RDMCHCLR, ((uint32_t)1U << RTDMAC_CH));
+ mmio_write_32(RTDMAC_RDMCHCLR, BIT(RTDMAC_CH));
mmio_write_32(RTDMAC_RDMCHCRB(RTDMAC_CH), RDMCHCRB_DRST);
/* Enable DMA */
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