ARM: DRA74-evm: Use SMA_1 spare register to workaround DP83865 phy on SR2.0
authorNishanth Menon <nm@ti.com>
Thu, 13 Aug 2015 14:51:00 +0000 (09:51 -0500)
committerTom Rini <trini@konsulko.com>
Fri, 28 Aug 2015 16:33:13 +0000 (12:33 -0400)
commit76cff2b10857c86211ef60024e672ce178cb6d69
treefdf9d2554b43cbcd5e08c0c0e51b2344a8224896
parent03589234090db645f80896a2ee5bce98096172da
ARM: DRA74-evm: Use SMA_1 spare register to workaround DP83865 phy on SR2.0

DP83865 ethernet phy used on DRA74x-evm is quirky and the datasheet
provided IODELAY values for standard RGMII phys do not work.

Silicon Revision(SR) 2.0 provides an alternative bit configuration
that allows us to do a "gross adjustment" to launch the data off a
different internal clock edge. Manual IO Delay overrides are still
necessary to fine tune the clock-to-data delays. This is a necessary
workaround for the quirky ethernet Phy we have on the platform.

NOTE: SMA registers are spare "kitchen sink" registers that does
contain bits for other workaround as necessary as well. Hence the
control for the same is introduced in a generic SoC specific, board
generic location.

Signed-off-by: Nishanth Menon <nm@ti.com>
Reviewed-by: Tom Rini <trini@konsulko.com>
arch/arm/cpu/armv7/omap5/prcm-regs.c
arch/arm/include/asm/arch-omap5/dra7xx_iodelay.h
arch/arm/include/asm/arch-omap5/omap.h
arch/arm/include/asm/omap_common.h
board/ti/dra7xx/evm.c